FPGAにおけるアルゴリズムの効果的な実装技術とそのノウハウ 

~ FPGA高位設計と回路の構成、FPGAの機械学習への応用、回路のチューニングと高ロバスト回路化 ~

・画像、信号処理を例としてFPGAの数理レベルからアルゴリズム化とハードウェア化について修得する講座

・FPGAの実装における高速化と高信頼化のノウハウを修得し、システム開発に応用しよう!

 

講師の言葉

 AIはブームの渦中ですが、複雑なアルゴリズムや計算量問題は普遍的な課題です。高速処理のためにFPGAの推論エンジンへの応用も研究されています。これらアルゴリズムは逐次処理を前提に記述されていますが、これをハードウェアで並列実行することで高速化が可能です。プログラミング言語等の動作記述から並列化HDLを生成するHLS(High Level Synthesis)も進化の途上にあります。
 本講座では、まず画像、信号処理などを例として数理レベルからアルゴリズム化とハードウェア化について解説します。続いて実際のハード化における高速化、高信頼化のノウハウを整理していきます。さらにFPGAでは回路構成とアーキテクチャのマッチングで性能が変わります。この点をツールのうまい使い方と関連付けて解説します。

セミナー詳細

開催日時
  • 2019年01月22日(火) 10:30 ~ 17:30
開催場所 日本テクノセンター研修室
カテゴリー ソフト・データ・画像・デザイン
受講対象者 ・これからFPGA設計を始める方、すでにFPGA設計に従事している方
・設計プロジェクト管理を担当する方
・FPGAやLSIを含むソフト・ハードのシステム開発に関係する方、今後関わる方
予備知識 ・理工系専門学校修了・同程度の基礎学力
・ディジタル回路の基礎知識、プログラミング系言語(HDLができれば尚可)のいずれかの素養(センス)があればより理解が深まります
修得知識 ・FPGA設計の重要なポイントと実設計への最適パス
・FPGA設計の問題解決の手がかり、高速化と高信頼化
・組織開発とバグの出にくい設計体制構築の知識
・FPGAの特徴と開発ツールの仕組み、設計スキルの専門知識
・FPGAの特徴とHDL記述による効果的な階層設計、検証方法
・FPGA/ASICを含むシステムの高速、高信頼、大規模システム設計の基礎
・画像処理、信号処理の原理と効果的な実装方法
プログラム

1.FPGA高位設計と回路の構成
  (1). システム設計におけるFPGAの応用ケース
    a.ロジック型とMPU/DSP内蔵型システム設計モデル
    b.FPGAロジックレベル実装性能比較
  (2). HLSへの期待・進化と現状
  (3). 数理レベルからのアルゴリズム化と実装
    a.数式のアルゴリズム化と並列処理化
    b.数と演算の離散系への変換、フーリエ積分変換
  (4). 信号処理・画像処理の原理
    a.微積分の離散系への実装
    b.カーネル、行列演算と次元の拡張
  (5). ハードウェア・アーキテクチャを意識した上流設計
    a.FFTの基底とDFTの分解、FPGAへの実装
    b.FPGAの機械学習への応用について

2.FPGA開発のポイントと効果的な設計法
  (1). モジュールベースシステム設計
    a.方式設計、検証と階層化の方法
    b.アルゴリズムの直並列分解
    c.Verilog/VHDL記法のポイント
  (2). 回路の動作原理と設計ルール
    a.消費電力と安定動作回路の設計
    b.シンクロナイザとClock Domain Crossing設計
  (3). FPGAアーキテクチャとツールの活かし方
  (4). 回路のチューニングと高ロバスト回路化

キーワード FPGA HDL ASIC エンベデッドプロセッサ アルゴリズム 信号処理 リターゲット容易化 トップダウン設計 逐次・並列処理 ステートマシン マクロ VHDL Verilog シンクロナイザ パイプライン制御 高速シーケンサ
タグ AI・機械学習組み込みソフトFPGALSI・半導体
受講料 一般 (1名):49,500円(税込)
同時複数申込の場合(1名):44,000円(税込)
会場
日本テクノセンター研修室
〒 163-0722 東京都新宿区西新宿2-7-1 新宿第一生命ビルディング(22階)
- JR「新宿駅」西口から徒歩10分
- 東京メトロ丸ノ内線「西新宿駅」から徒歩8分
- 都営大江戸線「都庁前駅」から徒歩5分
電話番号 : 03-5322-5888
FAX : 03-5322-5666
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